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LTC2145-14/
LTC2144-14/LTC2143-14
18
21454314fa
TIMING DIAGRAMS
Double Data Rate CMOS Output Mode Timing
All Outputs Are Single-Ended and Have CMOS Levels
tD
tC
tL
BIT 0
A-6
BIT 1
A-6
BIT 0
A-5
BIT 1
A-5
BIT 0
A-4
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A-4
BIT 0
A-3
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A-3
BIT 0
A-2
BIT 12
A-6
BIT 13
A-6
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A-5
BIT 13
A-5
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A-4
BIT 13
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A-3
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A-2
ENC–
ENC+
D1_0_1
D1_12_13
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B-6
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B-6
BIT 13
B-6
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BIT 13
B-5
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B-4
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BIT 13
B-3
BIT 12
B-2
OF
B-6
OF
A-6
OF
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OF
A-5
OF
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OF
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OF
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OF
B-2
D2_0_1
D2_12_13
CLKOUT+
CLKOUT–
OF2_1
21454314 TD02
tH
tAP
A + 1
A + 2
A + 4
A + 3
A
CH 1
ANALOG
INPUT
tAP
B + 1
B + 2
B + 4
B + 3
B
CH 2
ANALOG
INPUT
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